摩尔定律天水锚索钢绞线，有救了？

IBM 出大家款 0.7 纳米芯片制程节点，指甲盖大小的芯片上集成近 1000 亿个晶体管，密度达到 2 纳米芯片的两倍。

此前台积电制程为 2nm，已多年难以率先。

英伟达 CEO 黄仁勋曾屡次声称摩尔定律已死，当今终于有了鬈曲。

0.7 纳米，即 7 埃米，东说念主类制造的晶体管次浮松 1 纳米门槛，靠近单个原子的标准（0.1-0.5 纳米）。

与 2 纳米制程比拟，不错让能赞成 50，或能赞成 70，二选。

纳米堆叠架构登场

已毕这浮松的中枢，是 IBM 的"纳米堆叠"（NanoStack）架构，业界个基于纳米片的三维垂直堆叠晶体管瞎想。

顺序会 NanoStack，需要先总结芯片架构这几年走过的路。

在 7 纳米和 10 纳米时期，主流案是 FinFET 鳍式晶体管，栅从三面包裹通说念来适度电流。到了 5 纳米以下，FinFET 的走电问题日益严重，撑不住了。

IBM 在 2017 年出全环绕栅（GAA）纳米片工夫，栅从四面包裹住水平堆叠的纳米片通说念，静电适度智商大幅增强。这成了其 2 纳米芯片的工夫基础，也被台积电、三星等主流厂商跟进吸收。

2021 年底，IBM 又与三星联发布 VTFET 垂直传输场应晶体管天水锚索钢绞线，把电流向从水平改为垂直，仿真数据自大，比拟同尺寸 FinFET 案能翻倍或能耗裁汰 85。

此次的 NanoStack 是上述门道的率先蔓延。

它的作念法是：

取两片带有纳米片晶体管的晶圆，将其中片倒扣在另片上，锚索通过薄介电键粘，酿成垂直互联的三维结构。每层不错使用不同的材料组，n 型和 p 型晶体管各自强化，互不搅扰。

IBM 已在实验室中完成了考证，CMOS 集成、双通说念工程智商展示、以及完备且开关能符预期的 CMOS 反相器，证据该工夫可被实质制造并撑抓着实规划。

在 VLSI 2026 大会上，IBM 率先展示了 NanoStack 在 SRAM 上的发达：面积缩减 40。SRAM 是片上缓存的中枢构成部分，弥远以来微缩难度大，这进展对 AI 芯片所需的带宽数据通路尤为要津。

"没东说念主念念为电费买单"

IBM 规划院细密芯片研发的总裁 Huiming Bu 暗示：每个东说念主齐要的能，但没东说念主念念为电费买单。

这恰是面前 AI 算力竞赛面对的履行，AI 芯片的能耗照旧从工夫问题演变为基础标准问题，部分数据中心名堂因法获取敷裕的电力供应而出现建造展期。

0.7 纳米工夫提供的 70 能赞成，平直对应了这需求。

不外，IBM 本人已不再制造和销售芯片。它在纽约州奥尔巴尼的研发中心开辟制造工艺工夫，再授权给芯片厂商使用。

曩昔的被授权包括三星和日本新设立的半体公司 Rapidus。Huiming Bu 拒清醒 0.7 纳米工夫的潜在客户。

竞争案上，比利时规划机构 Imec 正在进另种三维架构案，通过逐层堆叠构建晶体管结构，已眩惑多芯片制造商的宥恕。

关于量产，IBM 给出的时期表是：NanoStack 工夫早在将来 5 年内已毕量产。

IBM 的半体门道图预计，借助 NanoStack 架构，芯片微缩至少还能不息十年。

参考相接：

[ 1 ] https://newsroom.ibm.com/2026-06-25-ibm-debuts-worlds-first-sub-1-nanometer-chip-technology

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